| ... | ... | @@ -22,7 +22,7 @@ Le 01/04/2022 (de 16h30 à 17h): |
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Le 03/04/2022 (de 14h15 à 15h):
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- Table de vérité
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Le 04/04/2022 (de 15h05 à 16h409.
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Le 04/04/2022 (de 15h05 à 16h40):
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- Finalisation table de vérité + gitlab onglet Conception ([ici](https://gitlab-etu.ing.he-arc.ch/alexandr.maquet/vhdl-arc_uc/-/wikis/Conception))
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Le 11/04/2022 (de 15h05 à 16h40):
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| ... | ... | @@ -57,3 +57,10 @@ Le 26.05.2022 (de 8h à 11h): |
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Le 30.05.2022 (de 15h05 à 16h40):
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- Debug des erreurs de syntèse et début testbench
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Le 10.06.2022 (de 22h à 23h30):
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- Reprise et analyse du bloc alu.vhd après avoir remarqué qu'il manquait un process. (Merci Audrey!)
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Le 11.06.2022 (de 9h à 11h & de 14h à 17h):
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- Refonte de l'alu.vhd, retrait des signaux temporaires inutiles. Ajout d'un ccr_in dans l'entité, 2ème process pour mettre à jour les drapeaux.
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- Continution des testbench |
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